用FPGA自带的锁相环(PLL)配置两个时钟是出问题了，求解答???
2013-2-26 20:33
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我用FPGA要分配两个时钟，用自带的锁相环(PLL)进行配置。晶振是50Mhz的，分配一个170Mhz的时钟和一个150Mhz ...
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