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请问各位大神一个PNP三极管漏电流的问题
[attach]1520436[/attach] [attach]1520438[/attach] [color=#333333][font=Arial]图1是我改前的[/font][/color][color=#4183c4][font=Arial]电路[/font][/color][color=#333333][font=Arial],作用是用5V[/font][/color][color=#4183c4][font=Arial]电源[/font][/color][color=#333333][font=Arial]给板上一个法拉电容充电,VCLK是给[/font][/color][color=#4183c4][font=Arial]时钟[/font][/color][color=#4183c4][font=Arial]芯片[/font][/color][color=#333333][font=Arial]的供电,当板断电时,此法拉电容将会维持对VCLK的供电,实际使用中发现,断电后两个PNP[/font][/color][color=#4183c4][font=Arial]三极管[/font][/color][color=#333333][font=Arial]的漏电流都很大,我将法拉电容充电至4.7V后,断电去掉时钟芯片后[/font][/color][color=#4183c4][font=Arial]测量[/font][/color][color=#333333][font=Arial]R6与R7的压降,R6有150mV,R7有20mV左右,即这两个管子都有150uA左右的漏电流,但规格书上Icbo都只有100nA明显不符。[/font][/color] [color=#333333][font=Arial]我按图2的电路更改,其他部分都没动,将R5由射极移到集电极,结果就没有漏电流了,上电的时候也能正常工作,请问各位大神这是什么原理?为什么移动下R5的位置就没有漏电流了?另外我发现漏电流大小与法拉电容电压成正比,请问这又是什么原因?[/font][/color] [color=#333333][font=Arial]替一位同行代问[/font][/color]
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