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GD32F350使用ADC+DMA采集ADC的同时开启TIMER13定时器进行信号输入捕获,发现捕获出错

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GD32F350 使用ADC+DMA采集ADC的同时,开启TIMER13定时器进行信号输入捕获,发现TIMER13捕获出错。分别运行就不会有问题,例如先进行ADC+DMA采集完后再进行TIMER13的捕获也是正常的,同时进行就不对。

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沙发
zhouyong77| | 2025-5-26 07:57 | 只看该作者
是不是ADC和定时器的配置存在冲突了

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板凳
daichaodai| | 2025-5-26 08:11 | 只看该作者
检查一下两者之间是不是有什么冲突配置项

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地板
dffzh| | 2025-5-26 11:13 | 只看该作者
本帖最后由 dffzh 于 2025-5-26 11:14 编辑

应该是两者的代码配置有点问题吧,可以试试按以下方向排查一下:
1、如果都用了中断,确认一下中断优先级配置;
2、如果都用了DMA,确认一下DMA资源配置;
3、确认一下GPIO引脚资源是不是有复用冲突?
ADC采集用的哪个IO口?
TIMER捕获用的哪个IO口?
发来,我有空帮你看下用户手册。

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xionghaoyun| | 2025-5-26 11:29 | 只看该作者
1.优先级 2.ADC开始采集把中断使能关了

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xiaox314|  楼主 | 2025-5-29 09:33 | 只看该作者
dffzh 发表于 2025-5-26 11:13
应该是两者的代码配置有点问题吧,可以试试按以下方向排查一下:
1、如果都用了中断,确认一下中断优先级配 ...

具体程序是PA1用于ADC采集(过采样32次),使用DMA传输4次采集数据,在这个过程中使用TIMER2_CH0(PA6)口用外部输入频率为输入时钟,累计12500次输出比较模式翻转TIMER2_CH2输出(PB0),(PB0和PB1连接)然后触发TIMER13_CH0(PB1)进行捕获采集,TIMER13开了更新和捕获中断,现在发现的是只要遇到捕获信号时,TIMER13的更新中断就没进(例如TIMER13, 8ms进一次更新中断,但遇到捕获信号,PB1由低变高时,或由高变低时,16ms后才进更新中断)。如果不同时使用ADC+DMA采集,又是正常的

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dffzh| | 2025-5-29 10:01 | 只看该作者
本帖最后由 dffzh 于 2025-5-29 11:10 编辑
xiaox314 发表于 2025-5-29 09:33
具体程序是PA1用于ADC采集(过采样32次),使用DMA传输4次采集数据,在这个过程中使用TIMER2_CH0(PA6) ...

1、看下DMA中断和TIMER13更新中断的优先级配置情况(主优先级和子优先级分别是多少)?
2、ADC采样频率和DMA传输速率降低试试呢;
3、DMA是什么模式?是循环模式吗?
4、用逻辑分析仪或示波器对比测试一下正常时和异常时的捕获信号的波形,看是否正常?看波形排查是比较有效的方式;
5、类似问题,我们一般会在debug时看下相关外设的相关寄存器位的状态是否正常;
比如触发更新中断异常时,看下更新中断对应的寄存器标志位是0还是1,到底是标志位有了没进中断还是标志位都没置位。



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xiaox314|  楼主 | 2025-5-29 13:45 | 只看该作者
dffzh 发表于 2025-5-29 10:01
1、看下DMA中断和TIMER13更新中断的优先级配置情况(主优先级和子优先级分别是多少)?
2、ADC采样频率和D ...

1. DMA的中断是nvic_irq_enable(DMA_Channel0_IRQn,1,1);TIMER13的中断是nvic_irq_enable(TIMER13_IRQn, 0, 1);

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xiaox314|  楼主 | 2025-5-29 13:50 | 只看该作者
dffzh 发表于 2025-5-29 10:01
1、看下DMA中断和TIMER13更新中断的优先级配置情况(主优先级和子优先级分别是多少)?
2、ADC采样频率和D ...

2.ADC是1M的时钟,DMA是开了循环模式;不开循环模式,每次采集需把DMA重新初始化一遍,这样也会导致TIMER13捕获出错
3.正常时和异常时,输入的波形(待捕获)都是一样的,就是监测到TIMER13更新中断异常

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dffzh| | 2025-5-29 14:05 | 只看该作者
xiaox314 发表于 2025-5-29 13:50
2.ADC是1M的时钟,DMA是开了循环模式;不开循环模式,每次采集需把DMA重新初始化一遍,这样也会导致TIMER ...
看来只能把代码工程发来,我才能帮忙继续分析分析了,方便的话就发。

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麻花油条| | 2025-5-29 15:47 | 只看该作者
检查DMA通道和定时器通道是否配置正确,避免硬件资源冲突。

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powerantone| | 2025-5-29 15:49 | 只看该作者
DMA、定时器配置是否正确。

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probedog| | 2025-5-29 15:50 | 只看该作者
代码逻辑问题?

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classroom| | 2025-5-29 15:51 | 只看该作者
建议在代码中添加错误处理机制。

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flycamelaaa| | 2025-5-29 16:30 | 只看该作者
ADC、DMA和TIMER13的时钟不稳定可能导致数据传输错误或捕获失败。

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stormwind123| | 2025-5-29 18:30 | 只看该作者
如果用了中断,检查中断优先级设置是否合理。

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