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Verilog HDL 学习要点总结(二)
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编写具有100%可靠性代码的几个技巧
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FPGA论坛 lxAPP 2012-10-14 1 960 GoldSunMonkey 2012-10-14 20:43
Verilog的两个误区
verilog ，阻塞 ，阻塞赋值 ，时序 ，se
FPGA论坛 xiao6666 2012-10-14 5 1315 lxAPP 2012-10-29 22:54
FPGA时序约束的几种方法
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Verilog assign和always 注意事宜
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FPGA论坛 星星之火红 2012-10-13 12 1729 Backkom80 2012-11-14 08:11
时序的几个概念
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FPGA论坛 shang651 2012-10-12 2 1429 GoldSunMonkey 2012-10-12 21:54
I2C时序问题
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万利电子 xsgy123 2012-10-11 4 935 baidudz 2012-10-11 23:52
弱弱地问下STM32的硬件SPI问题
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ST MCU chenfzg 2012-10-11 2 1358 chenfzg 2012-10-12 13:09
FPGA/CPLD状态机稳定性研究
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FPGA论坛 wmsk 2012-10-9 3 1255 wmsk 2012-10-9 21:55
常规延迟和内嵌延迟
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FPGA论坛 shang651 2012-10-8 5 1462 GoldSunMonkey 2012-10-9 20:56
如何发现并解决FPGA设计中的时序问题
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FPGA论坛 xjsxjtu 2012-9-29 13 1902 XiaoWei369 2013-1-19 22:15
ip核生成了一个fifo，不能写入数据 attach_img
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FPGA论坛 andiwxz 2012-9-26 5 1429 andiwxz 2012-9-27 12:28
此种情况如何做时序约束 attach_img
时序 ，OFFSET ，se ，FPGA ，PGA
FPGA论坛 magic323 2012-9-24 32 4713 GoldSunMonkey 2012-10-9 22:13
FPGA的高级学习计划
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FPGA论坛 huofeijingfe 2012-9-21 37 3585 GoldSunMonkey 2012-11-8 00:23
【汉普】高速信号仿真分析
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供需广告 wswnihao 2012-9-20 0 810 wswnihao 2012-9-20 16:42
怎样提速？
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FPGA论坛 tmkdfan 2012-9-19 17 2276 ledaa 2012-9-27 15:39
提高FPGA设计效能的方法
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FPGA论坛 gaochy1126 2012-9-15 5 1226 hongong 2012-9-20 17:12
请教时序约束的方法
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FPGA论坛 wrigleymint 2012-9-14 4 1747 Backkom80 2012-9-15 16:27
ARM怎么读写SJA1000? attach_img
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嵌入式操作系统论坛 jlgcumt 2012-9-21 9 3622 csliu911 2015-11-23 16:53
planAhead 中的时序违规怎么处理？ attach_img
PlanAhead ，时序 ，ck ，se ，TI
FPGA论坛 magic323 2012-9-24 10 2647 magic323 2012-9-26 12:49
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