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FPGA论坛 星星之火红 2012-10-20 16 2655 xiao6666 2012-10-22 21:39
提高NC-Verilog仿真效率的技巧
verilog ，仿真 ，ce ，TI ，时序
FPGA论坛 xjsxjtu 2012-10-18 3 2123 GoldSunMonkey 2012-10-21 21:13
请问差分时钟输入时序约束怎么做的？
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FPGA论坛 flykite 2012-10-17 2 3591 kkzz 2012-10-19 13:06
怎么用示波器看时序？？
时序 ，示波器 ，开发板 ，sd ，iic
新手园地 qQ191727779 2012-10-16 16 10002 wangchu426 2012-12-5 16:04
Verilog HDL 学习要点总结(二)
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FPGA论坛 shang651 2012-10-14 1 2070 GoldSunMonkey 2012-10-14 20:42
编写具有100%可靠性代码的几个技巧
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FPGA论坛 lxAPP 2012-10-14 1 1310 GoldSunMonkey 2012-10-14 20:43
Verilog的两个误区
verilog ，阻塞 ，阻塞赋值 ，时序 ，se
FPGA论坛 xiao6666 2012-10-14 5 1832 lxAPP 2012-10-29 22:54
FPGA时序约束的几种方法
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FPGA论坛 星星之火红 2012-10-14 3 2601 星星之火红 2012-10-14 17:49
Verilog assign和always 注意事宜
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FPGA论坛 星星之火红 2012-10-13 12 2619 Backkom80 2012-11-14 08:11
时序的几个概念
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FPGA论坛 shang651 2012-10-12 2 2026 GoldSunMonkey 2012-10-12 21:54
I2C时序问题
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万利电子 xsgy123 2012-10-11 4 1365 baidudz 2012-10-11 23:52
弱弱地问下STM32的硬件SPI问题
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ST MCU chenfzg 2012-10-11 2 1767 chenfzg 2012-10-12 13:09
FPGA/CPLD状态机稳定性研究
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FPGA论坛 wmsk 2012-10-9 3 2060 wmsk 2012-10-9 21:55
常规延迟和内嵌延迟
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FPGA论坛 shang651 2012-10-8 5 2185 GoldSunMonkey 2012-10-9 20:56
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FPGA论坛 xjsxjtu 2012-9-29 13 2528 XiaoWei369 2013-1-19 22:15
ip核生成了一个fifo，不能写入数据 attach_img
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FPGA论坛 andiwxz 2012-9-26 5 1983 andiwxz 2012-9-27 12:28
planAhead 中的时序违规怎么处理？ attach_img
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FPGA论坛 magic323 2012-9-24 10 3363 magic323 2012-9-26 12:49
此种情况如何做时序约束 attach_img
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FPGA论坛 magic323 2012-9-24 32 5659 GoldSunMonkey 2012-10-9 22:13
ARM怎么读写SJA1000? attach_img
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嵌入式操作系统论坛 jlgcumt 2012-9-21 9 4233 csliu911 2015-11-23 16:53
FPGA的高级学习计划
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FPGA论坛 huofeijingfe 2012-9-21 37 4680 GoldSunMonkey 2012-11-8 00:23
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