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时序设计问题！
时序设计 ，HDL ，VHDL ，电路 ，脉冲
嵌入式操作系统论坛 qingcaihui 2007-1-30 12 2474 qingcaihui 2007-2-5 18:51
FPGA内部锁相环电路
FPGA ，锁相环电路 ，HDL ，VHDL ，编写
ZLG sfhgky 2009-8-4 11 2146 年轻不在 2010-3-22 21:53
FPGA开发主要用VHDL还是Verilog HDL呢？
verilog ，VHDL ，FPGA开发 ，VerilogHDL
ZLG S3C2440 2010-1-17 11 2190 xiaoxin1986 2010-2-22 20:50
VHDL基础讲解 attachment
HDL ，VHDL ，hd
EDA 技术 hellonihao 2011-8-22 11 2161 RaiseCom 2013-4-6 23:01
为什么要学verilog
verilog ，verilo ，HDL ，VHDL ，hd
EDA 技术 海川先生 2012-4-1 11 2047 热血的人 2012-5-26 10:42
求助：VHDL的变量赋值
VHDL ，PROCESS ，BLE ，Variable ，TE
FPGA论坛 神之胡之 2012-4-8 11 3145 GoldSunMonkey 2012-5-29 23:31
下面的vhdl写法是否合法？
HDL ，VHDL ，hd ，se ，RS
EDA 技术 limee 2007-5-11 11 2151 frily 2007-6-2 19:26
VHDL 的 helloword
hello ，VHDL ，vi ，IO ，TI
ZLG FVJFIFE 2011-8-24 11 1908 明天我还来 2011-10-27 17:07
咨询个VHDL CASE语句公共分支的问题
VHDL ，se ，state ，TE ，ST
FPGA论坛 xdwumin 2012-2-22 11 2233 diny 2012-3-26 22:48
分享一个较经典的VHDL教程
HDL ，VHDL ，hd
电子技术交流论坛 虫虫儿 2008-12-22 11 2547 wuji2005 2010-4-25 20:49
VHDL程序设计 attachment
HDL ，VHDL ，VHDL程序 ，hd ，AC
FPGA论坛 梅花望青竹 2012-5-29 11 1389 心愿wish 2012-6-21 13:30
哪位大侠能比较一下verilog和VHDL这2个语言啊
HDL ，verilog ，VHDL ，verilo ，hd
EDA 技术 yuri714 2009-8-24 11 2435 yuri714 2009-8-26 23:08
关于VHDL信号赋初值？？
VHDL ，信号 ，logic ，SIGNAL ，VECTOR
FPGA论坛 pangning7085 2013-5-23 11 13862 qingniao966 2013-5-30 20:47
vhdl 中generic语句的用法 attach_img
VHDL ，generic ，ADDR ，AD ，DDR
FPGA论坛 hlhfootbal 2011-12-7 10 9777 GoldSunMonkey 2013-3-21 21:36
菜鸟向大家请教一个VHDL问题
VHDL ，AN ，ic ，logic ，ST
EDA 技术 sdnd2000 2007-5-3 10 2087 dspjs 2007-7-17 11:33
我问一个VHDL的问题大家过来看一下 谢了
VHDL ，se ，ST ，logic ，ic
EDA 技术 风中De舞者 2007-8-24 11 1757 伊处 2007-9-2 13:49
求一段VHDL程序 attach_img
HDL ，VHDL ，VHDL程序 ，hd ，AC
EDA 技术 zhangjie5168 2009-8-13 11 1950 zhangjie5168 2009-8-20 08:18
急切解决的VHDL问题，大家帮下忙！
VHDL ，points ，point ，ST ，logic
EDA 技术 jht123456789 2010-3-18 11 3548 mr.king 2010-5-2 07:14
vhdl教程 attachment
HDL ，VHDL ，hd
FPGA论坛 老大的幸福 2011-4-22 11 2083 HORSE7812 2011-8-7 11:55
VHDL FOR LOOP 应用问题
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FPGA论坛 nono2000 2012-11-12 11 2899 GoldSunMonkey 2012-11-14 18:47
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