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AT32F421在keil中可以使用软件仿真吗? 如何在logic analyzer中查看IO口的状态? attach_img
analyzer ，keil ，logic ，软件仿真 ，IO ，CAN
雅特力AT32 MCU weixiaoxiaoji 2021-9-4 3 3448 数据采集存储 2021-9-8 10:26
"exclusive or" logic gate是什么意思
logic ，TE ，ic
English Corner dsliumail 2008-7-4 3 1809 dsliumail 2008-7-6 10:34
请教等精度测频问题 attach_img
等精度测频 ，ST ，ic ，logic ，SIGNAL
EDA 技术 sz130 2011-9-5 3 1612 utopiaworld 2011-9-7 20:56
有哪些代码测试工具
代码 ，ST ，logic ，ic ，pc
ST MCU xiepengchenghn 2011-12-27 3 1620 午夜霓虹 2011-12-27 15:34
pads logic栅格不能设置为奇数吗？ attach_img
logic ，pads ，栅格 ，软件 ，pads9.5
EDA 技术 前途迷茫 2015-8-10 3 988 关关 2015-8-12 09:12
【求助】saleae上位机的连接问题
上位机 ，ic ，logic ，analyzer ，BLE
DIY讨论区 springvirus 2016-10-29 3 2142 springvirus 2019-12-5 08:10
大家用过PowerPCB么
POWERPCB ，POWERLOGIC ，ic ，logic ，TE
PCB技术 limee 2007-4-23 3 1853 楼上的 2007-4-24 16:48
关于orcad,pads logic,pads layout的问题
pads ，layout ，logic ，OrCAD ，原理图
PCB技术 lomeisi_99 2009-3-11 3 6470 fliger 2012-2-7 00:28
System Generator Clock Enable Logic Optimization attachment
ck ，generator ，System ，Optimization ，logic
FPGA论坛 AutoESL 2011-4-22 3 2074 hjjnet 2011-4-23 13:21
高举本土大旗，FPGA市场冲出黑马
FPGA ，ic ，TE ，logic ，芯片
FPGA论坛 xjsxjtu 2013-9-8 3 1629 GoldSunMonkey 2013-9-9 23:43
求解。pads9.5**后，logic可用，laout和router打不开。 attachment
pads9.5 ，logic ，router ，se ，ce
PCB技术 湘南一叶 2016-4-11 3 1225 lifax 2016-4-18 23:21
用过PADS的请进，请教一个问题 attach_img
pads ，AC ，ADSL ，logic ，PADSlogic
电子技术交流论坛 HuangLisen 2014-3-10 3 1188 HuangLisen 2014-3-10 16:52
求一个文档，74HC/HCT/HCU/HCMOS Logic Family Specifications attachment
CMOS ，Family ，logic ，Specifications ，HC
模拟技术论坛 6688hyc 2019-2-16 3 1984 holle 2019-2-16 19:48
关于分频器的疑问
分频器 ，TE ，LTE ，logic ，ic
EDA 技术 worrior_1 2009-3-9 3 1434 worrior_1 2009-3-10 16:23
有用Power Logic/PCB的朋友吗?我找到一个好东东,给大家分享 attachment
logic ，Power ，PCB ，软件 ，原理图
电子技术交流论坛 MasMosMes 2010-3-5 3 1942 cnchip 2010-3-16 19:00
基于FPGA 的SPI 自动发送模块设计实现
模块设计 ，FPGA ，spi ，logic ，ST
FPGA论坛 wmsk 2013-3-14 3 1186 GoldSunMonkey 2013-3-15 21:42
CCSV5有自带的 logic Analyzer？就像Keil4下的差不多的 attach_img
analyzer ，keil4 ，logic ，CCSv ，AC
德州仪器MCU Imakey 2013-10-14 3 1197 dirtwillfly 2013-10-15 07:47
求教VHDL 给端口赋值报错的问题
端口 ，VHDL ，TE ，LTE ，logic
FPGA论坛 李永宏A 2015-9-24 3 1347 李永宏A 2015-9-24 16:58
帮帮我看看哪里出问题了。达不到预期效果，我是个新手 attach_img
ic ，logic ，ST ，tmp ，VECTOR
FPGA论坛 xiaoxiao4816 2019-5-15 3 809 xiaoxiao4816 2019-5-23 10:17
求助---关于CPLD采集图象信号时序的问题
时序 ，CPLD ，信号 ，logic ，ic
EDA 技术 阿西西里 2007-4-10 3 1744 laner214 2007-4-12 08:36
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