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PADS_Logic元器件库管理 attachment
logic ，pads ，元器件 ，器件库
万利电子 renyunling18 2012-10-31 13 1895 gxgclg 2013-1-27 16:22
3b4b编码VHDL实现问题（带程序） attach_img
编码 ，VHDL ，ST ，ic ，logic
EDA 技术 well915 2013-4-7 12 3466 GoldSunMonkey 2013-4-16 23:56
关于xlinx 用户自定义 base 问题
se ，Xlinx ，ic ，logic ，ST
FPGA论坛 xlinxer 2011-10-14 12 2622 xlinxer 2011-10-17 09:42
我问一个VHDL的问题大家过来看一下 谢了
VHDL ，se ，ST ，logic ，ic
EDA 技术 风中De舞者 2007-8-24 11 1756 伊处 2007-9-2 13:49
初次编程，求大神指点
编程 ，ST ，logic ，ic ，TE
FPGA论坛 damoyeren 2013-7-26 11 4155 GoldSunMonkey 2013-7-29 21:47
xilinx的slice是什么意思？
ICE ，XILINX ，ic ，ce ，logic
FPGA论坛 clp510 2011-12-20 11 9836 GoldSunMonkey 2011-12-28 19:03
怎样检测最后一个脉冲 attach_img
脉冲 ，AC ，ST ，信号 ，logic
FPGA论坛 yuzhexian 2016-10-15 11 1044 玄德 2016-10-16 11:56
关于VHDL信号赋初值？？
VHDL ，信号 ，logic ，SIGNAL ，VECTOR
FPGA论坛 pangning7085 2013-5-23 11 13850 qingniao966 2013-5-30 20:47
怎么把LOGIC的BOM做得好一些，相同的元器件要合在一起，希... attachment
logic ，元器件 ，器件 ，ic
EDA 技术 无奈呵呵 2016-5-25 11 8209 实践才能出真知 2024-5-15 10:38
急切解决的VHDL问题，大家帮下忙！
VHDL ，points ，point ，ST ，logic
EDA 技术 jht123456789 2010-3-18 11 3544 mr.king 2010-5-2 07:14
中间信号是否需赋值的区别
信号 ，ge ，SIGNAL ，logic ，ic
FPGA论坛 wxfxwk1986 2011-3-1 11 2833 gavin_m 2011-4-12 19:11
新手请教一个VHDL程序问题，谢谢！
VHDL程序 ，buffer ，ST ，logic ，ic
EDA 技术 lzg12001 2009-11-27 11 3659 消失在冬季 2010-4-5 21:27
基于FPGA 的SPI 自动发送模块设计实现
模块设计 ，FPGA ，spi ，logic ，ST
FPGA论坛 tikelu 2011-12-14 10 1819 GoldSunMonkey 2011-12-16 20:45
quartus VHDL语言仿真问题 attach_img
仿真 ，vhdl语言 ，Quartus ，ST ，logic
FPGA论坛 wdoos 2012-11-3 10 1760 xiao6666 2012-11-18 17:06
用mdk的 logic analyzer 参数怎么设置？
analyzer ，logic ，MDK ，系列芯片 ，管脚
小华半导体 sxwnwxj 2020-7-10 10 1051 suw12q 2023-10-27 12:18
菜鸟向大家请教一个VHDL问题
VHDL ，AN ，ic ，logic ，ST
EDA 技术 sdnd2000 2007-5-3 10 2075 dspjs 2007-7-17 11:33
一个VDHL的程序问题 attach_img
TE ，ge ，ic ，ST ，logic
EDA 技术 小伟哥1101 2009-11-25 10 2636 waiting1988 2010-5-21 22:43
PADS Logic图文教程(共21部分)
logic ，pads ，ADSL ，PADSlogic ，元件
PCB技术 laji111 2009-12-13 9 3501 copperzy 2014-6-5 15:00
VHDL when 无法使用常数?
VHDL ，se ，IEEE ，logic ，ST
FPGA论坛 nono2000 2012-9-20 9 2199 GoldSunMonkey 2012-9-20 21:55
VHDL 编写 testbench attach_img
testbench ，编写 ，VHDL ，ic ，logic
FPGA论坛 cuianbin 2013-1-23 9 1818 ococ 2013-2-20 13:28
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