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关于如何用CPLD检测外部信号上升沿的问题 新手园地 漫游ing 2010-6-10 8 3107 漫游ing 2010-6-19 10:16
VHDL语言这样写是什么意思 FPGA论坛 entepino 2013-3-22 7 1399 GoldSunMonkey 2013-3-23 22:28
Verilog和VHDL的问题 FPGA论坛 wangch_sh 2014-8-24 7 1560 zhulin 2014-9-1 13:43
vhdl语言例程集锦 attachment ZLG ladygaga 2011-2-23 6 1785 libingqiao 2018-9-8 10:12
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请高手和有经验者推荐一本学习VHDL的书! EDA 技术 211C211 2010-5-12 6 4194 26022602 2010-5-26 22:23
请指教:vhdl语言编写的蜂鸣器发生模块。仿真结果不正确。 EDA 技术 f4335089 2009-7-9 5 4051 patrick007 2009-7-20 09:35
VHDL语言中 q <= (others => 0) 是什么意思 EDA 技术 liqz 2007-6-5 5 5075 dadong 2007-8-15 22:21
quartus VHDL语言仿真问题 attach_img FPGA论坛 wdoos 2012-11-3 5 1522 星星之火红 2013-1-17 20:37
VHDL语言能否计算出误码率? FPGA论坛 coco11 2011-5-25 5 1990 AutoESL 2011-5-26 09:08
急求 EDA vhdl语言 作业设计 更换板子之后如何设置引脚 attachment FPGA论坛 vanillachow 2012-12-16 4 1987 Dick00 2012-12-17 09:50
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怎样在2个脉冲的中间产生一个脉冲 attach_img
脉冲ACHDLVHDLvhdl语言
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vhdl语言每句程序耗时是多少? 电子技术交流论坛 amsung 2007-10-2 3 1661 李冬发 2008-7-8 17:28
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测试您的VHDL设计技巧 EDA 技术 liangzhitu 2007-9-19 3 1833 风中De舞者 2007-9-24 08:02
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求VHDL仿真软件,谢谢啦! 数字广电 liangxiao617 2010-6-10 3 2594 zilaifun 2010-10-8 16:38