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《用VHDL实现抢答器设计》的毕业设计资料合集（含大量毕... attachment
VHDL ，毕业设计 ，抢答器设计 ，Pay ，Mount
FPGA论坛 zszcn 2019-8-29 0 510 zszcn 2019-8-29 10:00
FPGA是什么？应用于哪方面？
FPGA ，电路 ，verilo ，verilog ，VHDL
FPGA论坛 mdy郭柏荣 2019-7-25 1 706 mdy郭柏荣 2019-7-25 16:29
求帮忙看一下这个原理图写的vhdl为什么不一样 attach_img
原理图 ，VHDL ，ST ，logic ，ic
FPGA论坛 洛杉矶been 2019-5-24 7 1064 zhangmangui 2019-5-26 21:19
VHDL 两个时钟问题 attach_img
VHDL ，时钟 ，ce ，rc ，电平
FPGA论坛 weicheichei 2019-5-6 3 849 rgvreferver 2019-6-16 00:02
VHDL 总线问题 attach_img
总线 ，VHDL ，ISM ，ce ，rc
FPGA论坛 weicheichei 2019-4-29 5 822 weicheichei 2019-4-30 16:21
状态机实践入门
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Navota NV32 MCU HKingS 2019-4-27 6 648 LY区区 2020-5-11 10:08
[转] vhdl数字钟的设计
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德州仪器MCU lefeng 2018-9-28 0 733 lefeng 2018-9-28 22:57
硬件还是软件
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Megawin(笙泉)单片机 guoyt 2018-9-19 21 1242 guoyt 2018-9-19 17:04
如何用VERILOG或VHDL写一段代码，实现10进制计数器？
verilog ，VHDL ，代码 ，进制计数器
新手园地 道子 2018-9-11 0 254 道子 2018-9-11 10:14
仿真问题
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德州仪器模拟论坛 wuhany 2018-8-15 9 451 wuhany 2018-8-16 09:28
VHDL 结构体中定义的ATTRIBUTE是什么？
TE ，VHDL ，ROM ，ST ，style
FPGA论坛 1273687647星木 2018-7-16 2 4625 1273687647星木 2018-7-18 15:33
4组数据混在一起，如何分离开来 attach_img
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FPGA论坛 paulkiyt 2018-6-12 6 1050 stickler 2018-6-18 09:04
FPGA和NiosII attachment
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EDA 技术 gaochy1126 2018-5-31 0 838 gaochy1126 2018-5-31 21:34
基于VHDL的FPGA和NiosII实例精炼 attachment
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EDA 技术 gaochy1126 2018-5-31 0 758 gaochy1126 2018-5-31 21:31
求大神解释储物柜电子密码程序VHDL
VHDL ，电子 ，logic ，ic ，ST
FPGA论坛 ak26843232656 2018-5-26 5 939 lihui567 2018-6-1 11:31
学fpga有出路么？
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FPGA论坛 hughzhao1780 2018-5-13 15 3795 雪山飞狐D 2018-7-27 10:58
quartus ii 中VHDL代码编译出现如下错误
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FPGA论坛 学习吧gg 2018-4-24 1 1398 学习吧gg 2018-4-24 15:26
vhdl ‘stable 函数 以及 ’delayed函数 无效
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FPGA论坛 syongy135 2018-4-15 2 1253 sxhhhjicbb 2018-4-16 09:11
谁能帮忙设计一个8位模型机，有偿的 attach_img
模型 ，CPU ，HDL ，VHDL ，hd
创业|外包|承接 yanhang456 2018-4-14 0 632 yanhang456 2018-4-14 23:05
用Verilog或VHDL写一段代码,实现消除一个glitch？
verilog ，VHDL ，代码 ，tc
新手园地 一片混沌 2018-9-11 0 141 一片混沌 2018-9-11 12:02
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