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如何完成多路影像切换到LCD的设计?
影像 ，LCD ，verlog ，MCU ，logic
工控、机电一体化 vincentyeh 2013-3-12 1 1321 airwill 2013-3-14 19:30
如何完成多路影像切换到LCD的设计?
影像 ，LCD ，verlog ，MCU ，logic
工控、机电一体化 vincentyeh 2013-3-12 1 1044 airwill 2013-3-12 18:23
VHDL这么写，有什么错？
VHDL ，LED ，logic ，ST ，ic
FPGA论坛 entepino 2013-3-7 7 1314 GoldSunMonkey 2013-3-8 21:21
HD高画质图框的同步设计
hd ，logic ，verlog ，ic ，TE
数字广电 vincentyeh 2013-3-5 0 970 vincentyeh 2013-3-5 15:36
请教一下括号里面东西的含义
logic ，ge ，ic ，ST ，Variable
FPGA论坛 loansat 2013-1-31 2 2099 薇儿安蓝 2013-1-31 09:48
VHDL 编写 testbench attach_img
testbench ，编写 ，VHDL ，ic ，logic
FPGA论坛 cuianbin 2013-1-23 9 1818 ococ 2013-2-20 13:28
寻找能开发ciruus logic的cs4525芯片应用板
logic ，芯片 ，ic
创业|外包|承接 xiami虾米 2013-1-14 0 1025 xiami虾米 2013-1-14 14:52
VHDL程序求解 attach_img
VHDL程序 ，ST ，ic ，logic ，VECTOR
FPGA论坛 神之胡之 2013-1-5 5 1507 VBird769 2013-1-12 22:31
给程序挑错
ST ，ic ，logic ，TE ，SIGNAL
FPGA论坛 mentoscui 2012-12-30 4 897 hawksabre 2013-1-2 18:18
【请教】quartus仿真时遇到的一个奇怪问题。 attachment
Quartus ，仿真 ，ic ，ST ，logic
FPGA论坛 catiya 2012-12-26 18 1720 GoldSunMonkey 2013-1-6 13:22
【请教】quartus仿真时遇到的一个奇怪问题。 attach_img
Quartus ，仿真 ，ic ，ST ，logic
EDA 技术 catiya 2012-12-26 7 1701 GoldSunMonkey 2012-12-28 23:05
纯小白在写作业，可是map过不去？报错啊。。。求助！！！ attachment
ST ，ic ，logic ，AN ，IO
FPGA论坛 zjj20081050 2012-12-23 23 3256 GoldSunMonkey 2012-12-24 22:07
小白求解 MAX PLUS 2运行提示错误。。 attach_img
ST ，logic ，ic ，ce ，VECTOR
嵌入式操作系统论坛 liuliuqiu051 2012-12-18 2 1133 zbhbyc 2012-12-20 09:32
我与赛灵思的2012+菜鸟也分享
赛灵思 ，ST ，ic ，logic ，SIGNAL
FPGA论坛 gygp 2012-12-12 18 2507 bestray 2014-9-12 11:44
提供amlogic am8726m3 aml8726mx方案
AMLogic ，logic ，mx ，ic
供需广告 caijin 2012-11-30 0 2063 caijin 2012-11-30 20:24
VHDL最基础的一个问题
VHDL ，area ，logic ，端口 ，tca
FPGA论坛 entepino 2012-11-29 9 1683 looope 2012-11-30 19:43
高分求消除简单的警告
ic ，ST ，logic ，ck ，TE
FPGA论坛 entepino 2012-12-11 6 3101 GoldSunMonkey 2012-12-14 22:25
求教，一个奇怪的错误，搜遍百度谷歌都不知道怎么解决
ST ，TE ，ic ，logic ，AD
EDA 技术 aa440981 2012-12-17 5 1413 GoldSunMonkey 2012-12-19 23:13
关于DDR设计的一个问题，急！！！！
DDR ，ck ，logic ，ic ，信号
FPGA论坛 djqlyy 2013-2-5 4 1735 GoldSunMonkey 2013-2-7 23:12
在CPLD上定义了输入输出口为总线数据线问题
总线 ，CPLD ，输入输出 ，logic ，ST
FPGA论坛 chenzhi658 2013-2-22 3 1411 chenzhi658 2013-2-22 14:54
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