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关于如何用CPLD检测外部信号上升沿的问题 新手园地 漫游ing 2010-6-10 8 3107 漫游ing 2010-6-19 10:16
PFGA与VHDL快速工程实践从入门到提高.pdf attachment
HDLVHDLpdhd
ZLG 我爸是李刚 2011-2-11 8 1993 libingqiao 2018-9-8 10:11
VHDL实现移相问题。。
VHDL移相时钟hz
EDA 技术 qingcaihui 2007-4-16 8 2284 qingcaihui 2007-4-30 00:16
VHDL OR Verilog
verilogVHDLFPGAPGA
FPGA论坛 zxl_maitian 2010-4-7 8 2524 heshang006 2010-4-13 22:32
例说Verilog和VHDL的区别,助你选择适合自己的硬件描述语言 attach_img
HDLVHDLhdveriloverilog
EDA 技术 gaochy1126 2023-1-31 7 1665 gaochy1126 2023-1-31 21:02
用altium编辑VHDL文件 中文注释重叠 attach_img
AltiumVHDLAC
EDA 技术 伯牙绝弦 2013-4-22 7 1703 伯牙绝弦 2013-4-28 00:08
其实数电也属于模电的一部分,分享一本数字逻辑设计的书 德州仪器模拟论坛 gaoyang9992006 2013-11-6 7 1687 lzm199516 2020-6-5 15:18
verilog HDL 与 VHDL的区别 EDA 技术 51xlf 2013-3-6 7 11150 elec921 2013-3-21 08:32
请教一个VHDL的问题(关于三态口的)
VHDLAI编译TErio
EDA 技术 xjcumt 2007-10-22 7 3009 liangzhitu 2007-10-24 17:00
急!VHDL中的时间描述
VHDLFIFOResetse
EDA 技术 jewson 2009-8-10 7 1819 hq190725 2009-8-10 23:11
Xilinx VHDL RAM 的初始化
RAMVHDLXILINXstartST
FPGA论坛 wrigleymint 2012-12-28 7 3027 dousfoulexd 2013-1-29 00:08
VHDL这么写,有什么错?
VHDLLEDlogicSTic
FPGA论坛 entepino 2013-3-7 7 1314 GoldSunMonkey 2013-3-8 21:21
关于VHDL编写的乘法器的问题 ZLG ycdianziguan 2009-2-20 7 1948 孤独行者 2009-10-25 10:35
vhdl菜鸟的初问
HDLVHDLhdRSse
EDA 技术 52mcu 2008-1-15 7 1656 yuhongwei 2008-11-21 18:09
这几句VHDL语句啥意思?
VHDLevdcAN
EDA 技术 nbziwei 2010-1-11 8 2329 小伟哥1101 2010-2-24 21:18
赛灵思,ALTERA,还有VHDL 和Verilog HDL FPGA论坛 amini 2011-1-25 8 2608 小云001 2011-4-8 22:50
VHDL中的库是什么
VHDLSTIEEEiclogic
ZLG 3B1105 2011-10-12 7 4553 xlhtracy 2011-11-29 16:23
小弟刚开始接触VHDL,FIFO程序有点问题
FIFOVHDLResetsePROCESS
FPGA论坛 luoyelq 2012-3-22 8 1602 GoldSunMonkey 2012-4-16 18:07
求助:modelsim中如何对VHDL仿真 FPGA论坛 nm2012 2013-10-16 7 1810 ococ 2013-10-17 15:28
Verilog和VHDL的问题 FPGA论坛 wangch_sh 2014-8-24 7 1560 zhulin 2014-9-1 13:43