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FPGA学习及设计中的注意事项
FPGA ，硬件 ，工程师 ，verilo ，verilog
FPGA论坛 jxfxyd 2014-7-7 0 739 jxfxyd 2014-7-7 10:35
【PsoC@4学习】+没做到最终的预期技术成果，却学到了思想与 attach_img
PSOC ，芯片 ，AC ，verilog ，verilo
英飞凌MCU论坛 mars4zhu 2014-6-30 12 1805 huigoushang 2014-7-31 12:26
Verilog的按键消抖与松手检测如何做到，求给个思路
verilog ，verilo
FPGA论坛 a2582006460 2014-6-24 8 3735 jomanliang 2014-6-30 09:03
xilinx fgpa软件外包（上海）
FGPA ，XILINX ，软件 ，verilo ，硬件平台
创业|外包|承接 hczsea 2014-6-20 6 1812 zhangyang768 2014-6-23 20:19
按键扫描程序的问题 attach_img
扫描程序 ，按键扫描 ，FPGA ，models ，verilo
FPGA论坛 magic_yuan 2014-5-23 7 1424 magic_yuan 2014-5-25 00:49
verilog初步赋值的情况
verilog ，verilo ，寄存器 ，vr
FPGA论坛 magic_yuan 2014-5-22 5 1610 neufeifatonju 2014-6-6 14:58
VHDL和Verilog换行符
HDL ，verilog ，VHDL ，verilo ，hd
EDA 技术 0林心诚0 2014-5-20 6 23661 520123 2014-5-22 18:15
Verilog always语句
verilog ，verilo ，触发
FPGA论坛 wdmhzh 2014-5-7 1 1099 bjzssg 2014-5-7 20:10
voerilog 用处疑问
芯片 ，verilo ，verilog ，数字电路 ，电路
FPGA论坛 wdmhzh 2014-5-7 4 1062 wjddyj 2014-5-8 08:18
Verilog 语句执行顺序
verilog ，verilo ，寄存器 ，端口
FPGA论坛 wdmhzh 2014-5-2 6 1600 wdmhzh 2014-5-7 10:49
一个verilog语法问题
verilog ，verilo ，sd
EDA 技术 294897997 2014-4-30 1 1001 294897997 2014-4-30 10:25
verilog的uart怎么设计
UART ，verilog ，verilo
EDA 技术 hudi008 2014-4-13 3 785 gaochy1126 2012-7-20 23:44
如何用verilog实现时钟的相位延迟？
verilog ，时钟 ，相位 ，verilo
FPGA论坛 技术达人 2014-2-24 2 4778 GoldSunMonkey 2014-3-6 00:08
Xilinx FPGA烧写问题 attach_img
FPGA ，XILINX ，烧写 ，verilo ，XC3S500E
FPGA论坛 cacjj 2014-1-11 6 1657 GoldSunMonkey 2014-3-22 23:17
程序之间的相互影响
时钟 ，ps ，verilo ，解码 ，编写
FPGA论坛 JokerLone 2014-1-4 8 1387 JokerLone 2014-1-6 20:40
Verilog的问题
verilog ，verilo
EDA 技术 houjiakai 2013-12-3 6 1703 happyming0809 2013-12-5 11:16
求ili9325 verilog 代码
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电子技术交流论坛 iamxiaozhang 2013-12-1 0 1347 iamxiaozhang 2013-12-1 10:38
拜拜FPGA!
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FPGA论坛 cuianbin 2013-11-5 12 2436 mamba_kb 2013-11-14 15:01
FPGA中两个模块间怎么传输大数据
FPGA ，PGA ，大数据 ，verilog ，verilo
FPGA论坛 jlgcumt 2013-11-3 2 1886 Backkom80 2013-11-5 07:57
UART波特率问题
UART ，verilog ，verilog程序 ，verilo
万利电子 hsbjb 2013-10-28 9 1547 smilingangel 2013-11-18 20:20
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